Intel 2760QM Datový list Strana 320
- Strana / 564
- Tabulka s obsahem
- KNIHY
Hodnocené. / 5. Na základě hodnocení zákazníků
Processor Uncore Configuration Registers
320 Datasheet, Volume 2
4.2.4.4 MESEG_BASE—Manageability Engine Base Address Register
4.2.4.5 MESEG_LIMIT—Manageability Engine Limit Address Register
MESEG_BASE
Bus: 1 Device: 12 Function: 6 Offset: 70h
Bit Attr
Reset
Value
Description
63:46 RV 0h Reserved
45:19 RW-LB
000000
0h
MEBASE
This field corresponds to A[45:19] of the base address memory range that is
allocated to the ME.
18:0 RV 0h Reserved
MESEG_LIMIT
Bus: 1 Device: 12 Function: 6 Offset: 78h
Bit Attr
Reset
Value
Description
63:46 RV 0h Reserved
45:19 RW-LB
000000
0h
MELIMIT
This field corresponds to A[45:19] of the limit address memory range that is
allocated to the ME. Minimum granularity is 1 MB for this region.
18:12 RV 0h Reserved
11 RW-LB 0h
EN
This bit indicates whether the ME Stolen Memory range is enabled or not. When
enabled, all IA access to this range must be aborted.
10 RW-LB 0h
MELCK
This field indicates whether all bits in the MESEG_BASE and MESEG_MASK
registers are locked. When locked, updates to any field for these registers must be
dropped.
9:0 RV 0h Reserved
- Datasheet, Volume 2 1
- November 2011 1
- Contents 3
- 4 Datasheet, Volume 2 4
- Datasheet, Volume 2 5 5
- 6 Datasheet, Volume 2 6
- Datasheet, Volume 2 7 7
- 8 Datasheet, Volume 2 8
- Datasheet, Volume 2 9 9
- 10 Datasheet, Volume 2 10
- Datasheet, Volume 2 11 11
- 12 Datasheet, Volume 2 12
- Datasheet, Volume 2 13 13
- 14 Datasheet, Volume 2 14
- Datasheet, Volume 2 15 15
- 16 Datasheet, Volume 2 16
- Datasheet, Volume 2 17 17
- 18 Datasheet, Volume 2 18
- Datasheet, Volume 2 19 19
- 20 Datasheet, Volume 2 20
- Datasheet, Volume 2 21 21
- 22 Datasheet, Volume 2 22
- Datasheet, Volume 2 23 23
- Revision History 24
- 1 Introduction 25
- 1.2 Related Documents 27
- 1.3 Register Terminology 28
- Introduction 30
- 30 Datasheet, Volume 2 30
- 2 Configuration Process and 31
- 32 Datasheet, Volume 2 32
- Datasheet, Volume 2 33 33
- 2.2.1 CSR Access 34
- 2.2.2 PCI Bus Number 34
- 2.2.3 Uncore Bus Number 34
- 2.3 Configuration Mechanisms 35
- 2.4 Device Mapping 35
- Configuration Registers 37
- Capability 38
- Type0 Header 38
- PCIe Capability 38
- PM Capability 38
- Datasheet, Volume 2 39 39
- Offset 00h–0FCh 40
- Offset 200h–2FCh 42
- Legacy Configuration Map 43
- 0h–1FFh 44
- 200h–2FCh 45
- Offset 400h–4FCh 46
- Common Configuration Space) 47
- : F0h (DMI2 MODE) 70
- : 98h (PCIe* MODE) 70
- : 9Ch (PCIe* MODE) 72
- B0h (DMI2 MODE) 73
- B2h (DMI2 MODE) 75
- : 1C2h (DMI2 MODE) 88
- : C2h (PCIe* MODE) 88
- Express 90
- Register – DMI2 Mode 95
- Register – Root Ports 96
- Register – DMI2 Port/PCIe* 107
- Bit Attr 108
- Header Register 109
- AER status bit to be set 115
- Error Mask Register 120
- Mask Register 121
- Control Register 121
- : 49C, 4A0 130
- : 4A4, 4A8 132
- 0, offset 50h] 134
- Table 3-10. Intel 146
- Table 3-11. Intel 147
- Table 3-12. Intel 148
- Offset 0h–FFh 149
- Offset 100h–1FFh 150
- 300h–3FFh 152
- Offset 00h–FFh 153
- Offset 200h–2FFh 154
- Express space 155
- “Capabilities List.” 156
- 3.3.3 Intel 160
- Base Address Register 161
- Limit Address Register 162
- 3.3.3.13 MENCMEM_LIMIT—Intel 165
- Address Register 165
- Decode Register 170
- VT-d Registers 173
- 3.3.3.26 VTGENCTRL—Intel 173
- 3.3.3.27 VTISOCHCTRL—Intel 174
- 3.3.3.28 VTGENCTRL2—Intel 175
- 3.3.3.31 VTUNCERRMSK—Intel 177
- 3.3.3.32 VTUNCERRSEV—Intel 177
- 3.3.3.33 VTUNCERRPTR—Intel 178
- DFx 0 Register 182
- DFx 1 Register 183
- Select Register 184
- 3.3.5 Local Error Registers 202
- Log 0 Register 204
- Log Register 216
- Header 0 Log Register 217
- I/OxAPIC Register 221
- Register Map Table 227
- 3.3.7.1 INDX—Index Register 228
- 3.3.7.2 WNDW—Window Register 228
- 3.3.7.4 EOI Register 229
- 3.3.7.5 APICID Register 229
- 3.3.7.6 VER—Version Register 229
- 3.3.8 Intel 233
- VT-d Memory Mapped Register 233
- Table 3-21. Intel 234
- Table 3-22. Intel 235
- Table 3-23. Intel 236
- Table 3-24. Intel 237
- Table 3-25. Intel 238
- 3.3.8.2 VTD0_CAP—Intel 239
- VT-d Capabilities Register 239
- VT-d Capability Register 240
- Base Register 248
- Pointer Register 250
- Status Register 251
- 3.3.8.44 VTD1_CAP—Intel 262
- Event Address Register 274
- Registers 277
- Register 277
- 4.1.6 CCR—Class Code Register 280
- DID VID 0h DRAM_RULE 80h 284
- Offset 00h–FCh 285
- Function 0, Offset 00h–FCh 287
- Function 0, Offset 100h–1FCh 288
- Offset 100h–1FCh 290
- DID VID 0h 80h 293
- 100h–1FCh 294
- 100h–1FCh 294
- 100h–1FCh 294
- 300h–3FCh 296
- 300h–3FCh 296
- 300h–3FCh 296
- DID VID 0h ROUNDTRIP0 80h 298
- 100h 180h 299
- 4.2.3 CBO unicast CSRs 301
- Pipe Response Function 303
- 4.2.3.8 SadDbgMm2 Register 304
- Configuration Shadow Register 311
- Target Register 339
- Config Register 343
- Counter Register 344
- 4.2.7.7 MH_EXT_STAT Register 347
- Type Registers 357
- : 80h, 84h, 88h 358
- OFFSET Register 359
- Limit Register 360
- Configuration Register 408
- Accumulator Register 412
- Threshold Register 412
- Timing Registers 418
- Parameter Register 419
- Register 420
- MR0 Shadow Register 426
- 4.2.14.12 RPQAGE Register 427
- 4.2.14.27 WDAR_MODE Register 436
- 4.2.14.28 SPARING Register 437
- ADDR Seq 0 Register 437
- Update Seq 0 Register 438
- LFSR Seq 0 Register 439
- Control Seq 0 Register 440
- Rank 0 Register 454
- 4.3.1 CSR Register Maps 465
- 4.4.1 CSR Register Maps 472
- 4.4.2 PCU0 Registers 476
- : 64h, 68h, 6Ch, 70h 478
- Limitation Register 486
- 4.4.3 PCU1 Registers 488
- 4.4.4 PCU2 Registers 498
- CH0 Register 503
- 4.4.5.2 CAP_HDR Register 509
- 4.4.5.3 CAPID0 Register 510
- 4.4.5.4 CAPID1 Register 511
- 4.4.5.5 CAPID2 Register 513
- 4.4.5.6 CAPID3 Register 514
- 4.4.5.7 CAPID4 Register 515
- 4.5.1 CSR Group 517
- 4.5.2.8 EVENTS_DEBUG Register 523
- Scratchpad 0 Register 523
- SMI generation control 526
- 4.6.1 CSR Register Maps 528
- Ch, E0h, E4h, E8h 530
- 4.6.2.7 HaPerfmonAddrMatch0— 533
- 4.6.2.8 HaPerfmonAddrMatch1— 533
- Value Register 534
- 4.7.1.5 R2PINGDBG Register 537
- 4.7.1.6 R2PEGRDBG Register 538
- 4.7.1.8 R2EGRERRLOG Register 539
- 4.7.1.9 R2EGRERRMSK Register 540
- 4.8 MISC Registers 543
- DDRIOTXRXBotRank0 Register 546
- DDRIOCompOvrOfst2 Register 555
- TCO evaluation 556
- 4.8.21 TXALIGN_EN Register 560
- 4.8.22 TXEQ_LVL0_0 Register 561
- 4.8.23 TXEQ_LVL0_1 Register 561
- 4.8.24 TXEQ_LVL1_0 Register 561
- 4.8.25 TXEQ_LVL1_1 Register 562
- 4.8.26 TXEQ_LVL2_0 Register 562
- 4.8.27 TXEQ_LVL2_1 Register 562
- 4.8.28 TXEQ_LVL3_0 Register 563
- 564 Datasheet, Volume 2 564
Související produkty a manuály pro Procesory Intel 2760QM
Procesory Intel P4X-0032-2M-800 Datový list
(6 stránky)
(6 stránky)
Procesory Intel i7-2960XM Datový list
(98 stránky)
(98 stránky)
Procesory Intel Core 2 Duo E7300 Specifikace
(49 stránky)
(49 stránky)
Procesory Intel Pentium D 840 Datový list
(106 stránky)
(106 stránky)
Procesory Intel SL22T Specifikace
(35 stránky)
(35 stránky)
Procesory Intel E3-1275 Datový list
(300 stránky)
(300 stránky)
Procesory Intel Core 2 Quad Q6700 Datový list
(98 stránky)
(98 stránky)
Procesory Intel T1700 Datový list
(98 stránky)
(98 stránky)
Procesory Intel 2 Duo T7500 Datový list
(87 stránky)
(87 stránky)
Procesory Intel L5618 Datový list
(64 stránky)
(64 stránky)
Procesory Intel B940 Datový list
(360 stránky)
(360 stránky)
Procesory Intel core 2 Duo T5850 Specifikace
(292 stránky)
(292 stránky)
Procesory Intel AT80569KJ073N Datový list
(102 stránky)
(102 stránky)
Flowserve ERPN-M manuály
Uživatelské manuály a uživatelské příručky pro Čerpadla Flowserve ERPN-M.
Poskytujeme 1 manuály pdf Flowserve ERPN-M ke stažení zdarma podle typů dokumentů: Uživatelský manuál
Flowserve ERPN-M Uživatelský manuál (37 strany)
Značka: Flowserve | Kategorie: Pumps | Velikost: 0.65 MB |
Tabulka s obsahem
Další produkty a příručky pro Čerpadla Flowserve
| Modely | Typ Dokumentu |
|---|---|
| Chemstar standard |
Uživatelský manuál
Flowserve Chemstar standard User Manual,
44 stránky
|
| NM |
Uživatelský manuál
Flowserve NM User Manual,
48 stránky
|
| LNGT |
Uživatelský manuál
Flowserve LNGT User Manual,
48 stránky
|
| Gearex Rotary Gear Pumps External and Internal Bea |
Uživatelský manuál
Flowserve Gearex Rotary Gear Pumps External and Internal Bearing User Manual,
50 stránky
|
| FRBHJC |
Uživatelský manuál
Flowserve FRBHJC User Manual,
42 stránky
|
| CPXV fitted with WW |
Uživatelský manuál
Flowserve CPXV fitted with WW User Manual,
36 stránky
|
| FRBH |
Uživatelský manuál
Flowserve FRBH User Manual,
54 stránky
|
| ATEX R |
Uživatelský manuál
  
Инструкция по эксплуатации Flowserve ATEX R,
20 stránky
|
| Byron Jackson Type M |
Uživatelský manuál
Flowserve Byron Jackson Type M User Manual,
68 stránky
|
| WDX |
Uživatelský manuál
Flowserve WDX Manuel d'utilisation,
48 stránky
|
| NMD |
Uživatelský manuál
Flowserve NMD Manuel d'utilisation,
40 stránky
|
| Mark 3 ISO Durco |
Uživatelský manuál
Flowserve Mark 3 ISO Durco Manuel d'utilisation,
56 stránky
|
| CPXV |
Uživatelský manuál
Flowserve CPXV Manuel d'utilisation,
48 stránky
|
| MENBLOC 60Hz |
Uživatelský manuál
Flowserve MENBLOC 60Hz Manuel d'utilisation,
40 stránky
|
| MEN |
Uživatelský manuál
Flowserve MEN Manuel d'utilisation,
40 stránky
|
| ME Bearing oil |
Uživatelský manuál
Flowserve ME Bearing oil Manuel d'utilisation,
40 stránky
|
| MEN |
Uživatelský manuál
Flowserve MEN Manuel d'utilisation,
40 stránky
|
| LR |
Uživatelský manuál
Flowserve LR Manuel d'utilisation,
56 stránky
|
| BP |
Uživatelský manuál
Flowserve BP Manuel d'utilisation,
45 stránky
|
| LN |
Uživatelský manuál
Flowserve LN Manuel d'utilisation,
36 stránky
|
© 2020, manymanuals.cz. Všechna práva vyhrazena. | 0.050 s |
Manymanuals.com
Manymanuals.de
Manymanuals.fr
Manymanuals.it
Manymanuals.pl
Manymanuals.cz
Manymanuals.es
Manymanuals-pt.com
Komentáře k této Příručce